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# 02 CPU、异常与中断
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## 目标
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建立 x86_64 CPU 基础设施，让 kernel 能捕获异常并接入后续硬件中断。
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## 前置条件
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- early log 可在 firmware 退出后稳定输出。
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- panic 路径可用。
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## 建议边界
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- `arch/x86/`：GDT、TSS、IDT、异常入口、IRQ 入口。
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- `kernel/`：通用 trap 分发、panic 策略、调试输出。
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- `include/tianole/`：必要的通用 trap 数据结构。
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## 实现内容
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- 建立 x86_64 GDT。
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- 建立最小 TSS。
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- 建立 IDT。
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- 增加异常入口汇编。
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- 保存寄存器到统一 trap frame。
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- C 层分发 exception。
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- 之后再接 PIC/APIC 和 IRQ。
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- 异常路径输出异常栈、寄存器现场和符号化所需信息。
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## 非玩具化约束
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- 汇编入口只保存现场和跳转，不写策略。
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- C handler 接收统一 trap frame。
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- exception 和 IRQ 的入口可共享框架，但语义要区分。
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- 不把中断处理写进 `kernel/main.c`。
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- oops/panic 策略要和 trap 分发分离。
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## 验收方式
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- 主动触发 invalid opcode 或 divide error。
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- 日志输出 vector、rip、rsp、error code。
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- 未处理异常进入 panic。
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